职位：硬件工程师
持续时间：10 个月
地点：加拿大安大略省马克汉姆或渥太华（完全现场办公）
经验：8 年以上
候选人将要做的工作：
• 开发块和 SoC 时序约束，进行全芯片 STA 设置及多角度多电压设计的签核。
• 负责时序流程和执行，以满足 SoC 时序要求，包括时序预算、重复器规划、约束/例外生成和管理。
• 与块和 SoC 设计团队紧密合作，理解设计需求、STA 约束及收敛挑战。
• 与物理实现团队紧密合作，确保设计满足质量要求并调试时序故障。
• 我们正在寻找的候选人：
• 10 年以上 ASIC 实现和 CAD 方法论的专业经验，最好有高性能设计的时序收敛经验。
• 在 ASIC STA 约束生成、时序分析、时序收敛和 ECO 方面，必须具备在块和全芯片级别的能力。
• 期望具备多电压设计的实施经验和知识。低功耗和多电源模式设计的 STA 收敛是额外的优势。
• 需要精通行业标准的 ASIC EDA 工具，包括 Synopsys DC 和 Primetime。
• 熟练掌握脚本语言，如 TCL、Perl 和/或 Python。
• 具备开发脚本以自动化设计流程和分析的经验。
• 具备物理设计实施的实践经验者优先。
• 较强的沟通能力，能够在多个项目之间多任务处理，并与地理分散的团队合作。
• 较强的分析/解决问题能力，注重细节。
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